Plattform für Software-Prototyping
Veloce proFPGA CS
Veloce ProFPGA CS ist die leistungsstärkste Software-Prototyping-Plattform, die für die Softwareverifizierung und die Validierung der Hardware-/Softwaresystemintegration optimiert ist. Dies ist eine hochflexible und erschwingliche Plattform, von einem FPGA bis hin zu mehreren Blades für sehr große Designs.
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Hochleistungs-Prototyping für die Softwareverifizierung
Die Software in den heutigen Produkten wird immer komplexer. Eine frühzeitige Überprüfung der Software ist der Schlüssel zum Produkterfolg und zur Markteinführungszeit. Veloce proFPGA CS ProFPGA-CS-Leistung, schnelle Schnittstellen und Skalierbarkeit ermöglichen es Softwareteams, Software lange vor der Verfügbarkeit von Silizium zu validieren und zu debuggen.
Leistung zuerst
Die Veloce proFPGA CS CS-Hardware wurde mit der höchstmöglichen Leistung als Hauptziel konzipiert. Leistung ist unerlässlich, um komplexe Software-Workloads zu verifizieren, das Betriebssystem zu starten und Anwendungen auf einer vollständig konfigurierbaren Prototyping-Plattform auszuführen, die auf die spezifischen Anforderungen des Projekts zugeschnitten ist. Das Veloce ProFPGA CS Desktop-System kann eine Leistung im Bereich von 100 MHz bieten.
Skalierbarkeit und Flexibilität
Veloce ProFPGA CS ist hochgradig skalierbar, von einem einzelnen Blade auf dem Schreibtisch bis hin zu Rackmontage-Konfigurationen mit mehreren Blades für Umgebungen mit mehreren Benutzern. Die Benutzer haben die Flexibilität, die Anzahl der FPGAs, der Verbindungen, der At-Speed-Protokollschnittstellen zu definieren, die den Überprüfungs- und Leistungsanforderungen des Projekts am besten entsprechen.
Schnelles Erheben
Veloce ProFPGA CS verfügt über eine automatische Software, um die Erstellung des Designs auf der Prototyp-Plattform zu beschleunigen. Die Veloce-Software macht die manuelle Aufgabe überflüssig, das Design so zu modifizieren, dass es FPGA-freundlich ist und keine Gefahr für das Timing darstellt, wenn es auf dem FPGA läuft. Die Software kann eine vollautomatische sowie benutzergeführte Partitionierung des Designs auf Multi-FPGA-Geräte durchführen.
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