Software Prototyping-Plattform
Veloce proFPGA CS
Veloce proFPGA CS ist die leistungsstärkste Software-Prototyping-Plattform, die für die Softwareverifizierung und die Validierung der Hardware-/Softwaresystemintegration optimiert ist. Dies ist eine hochflexible und erschwingliche Plattform, von einem einzelnen FPGA bis hin zu Multi-Blade-Geräten für sehr große Designs.
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Hochleistungs-Prototyping für Software Verifizierung
Die Software in den heutigen Produkten wird immer komplexer. Eine frühzeitige Überprüfung der Software ist der Schlüssel zum Produkterfolg und zur Markteinführungszeit. Veloce proFPGA CS-Leistung, schnelle Schnittstellen und Skalierbarkeit ermöglichen es Softwareteams, Software lange vor der Verfügbarkeit von Silizium zu validieren und zu debuggen.
Leistung an erster Stelle
Veloce proFPGA CS-Hardware wurde mit der höchstmöglichen Leistung als Hauptziel konzipiert. Leistung ist unerlässlich, um komplexe Software-Workloads zu verifizieren, das Betriebssystem zu starten und Anwendungen auf einer vollständig konfigurierbaren Prototyping-Plattform auszuführen, die auf die spezifischen Anforderungen des Projekts zugeschnitten ist. Veloce proFPGA Das CS-Desktop-System kann eine Leistung im Bereich von 100 MHz bieten.
Skalierbarkeit und Flexibilität
Veloce proFPGA CS ist hochgradig skalierbar, von einem einzelnen Blade auf dem Schreibtisch bis hin zu Rackmontagekonfigurationen mit mehreren Blades für Umgebungen mit mehreren Benutzern. Anwender haben die Flexibilität, die Anzahl der FPGAs, die Verbindungen und die At-Speed-Protokollschnittstellen festzulegen, die den Überprüfungs- und Leistungsanforderungen des Projekts am besten entsprechen.
Schnelles Aufbringen
Veloce proFPGA CS verfügt über eine automatische Software, um die Erstellung des Designs auf der Prototypplattform zu beschleunigen. Die Veloce-Software macht das manuelle Ändern des Designs überflüssig, sodass es FPGA-freundlich ist und keine Gefahr für das Timing bei der Ausführung auf dem FPGA besteht. Die Software kann sowohl eine vollautomatische als auch eine benutzergeführte Partitionierung des Designs auf Multi-FPGA-Geräte durchführen.
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