Các sự kiện và hội thảo trên web của Siemens EDA

Tìm hiểu cách các chiến lược cổng đồng hồ với báo cáo dựa trên mô-đun xác định các cơ hội tối ưu hóa theo tầng sâu trong đường dẫn quạt vào và quạt ra và tối đa hóa watt tiết kiệm trên mỗi giờ kỹ thuật, cho phép thiết kế công suất thấp.

Tìm hiểu cách ngôn ngữ PSS cho phép bạn chỉ định ý định xác minh và sử dụng Questa One để tạo các bài kiểm tra ngẫu nhiên cho bạn; và những thử nghiệm này có thể được “thực hiện” để chạy trên các nền tảng, công cụ và giai đoạn xác minh khác nhau.

Khám phá kiến trúc & vi kiến trúc SoftMax để cân bằng hiệu suất, diện tích, tài nguyên cho suy luận biên. Khám phá quy trình công việc thiết kế FPGA nhanh nhẹn để bắt kịp với các thuật toán đang phát triển.

Khám phá cách Questa One Sim tăng tốc mô phỏng với công nghệ ParallelSIM, PSS tích hợp, bộ giải ràng buộc VHDL, loại trừ phạm vi phủ sóng mã tự động và hơn thế nữa cho RTL, mô phỏng cấp cổng và phạm vi phủ sóng.

Hội thảo trên web này sẽ giới thiệu giao thức UALink, tập trung vào kiến trúc và các tính năng chính của nó cho phép các hệ thống AI có thể mở rộng; sau đó đi sâu vào các khả năng thiết yếu của Siemens Avery UALink Verification IP.

Hội thảo trên web này sẽ giới thiệu giao thức UALink, tập trung vào kiến trúc và các tính năng chính của nó cho phép các hệ thống AI có thể mở rộng; sau đó đi sâu vào các khả năng thiết yếu của Siemens Avery UALink Verification IP.

Khám phá Tổng hợp cấp cao và lợi ích của nó trong việc sản xuất bộ tăng tốc phần cứng một cách nhanh chóng và chính xác. Chúng tôi sẽ đề cập đến thiết kế từng bước và xác minh thuật toán Wake Word bằng HLS.

Quy trình làm việc kín đáo tạo ra tắc nghẽn làm chậm chu kỳ thiết kế và làm giảm chất lượng. Hội thảo trên web này giới thiệu một cách tiếp cận mới cho các môi trường xác minh hiệp đồng bằng cách sử dụng hệ sinh thái tích hợp của nhà phát triển Questa™ /IVE.

Khám phá cách Aprisa AI và hệ thống AI EDA của Siemens tăng năng suất RTL-to-GDS lên gấp 10 lần, hiệu quả thời gian tính toán gấp 3 lần và PPA lên 10%, với ML & RL, AI tổng hợp & đại lý để tăng tốc học tập và tự động hóa quy trình làm việc EDA.

Hội thảo trên web này cho thấy cách Questa One Property Assist biến lời nhắc của người dùng thành lời nhắc LLM được tối ưu hóa, truy xuất các giải pháp do LLM cung cấp và trình bày các thuộc tính SVA được tạo tốt nhất cho người dùng.

Hội thảo trên web này giới thiệu Questa One Sim CX, một giải pháp mô phỏng theo hướng phủ sóng sáng tạo, cách mạng hóa việc xác minh UVM bằng cách tự động hóa suy luận về phạm vi phủ sóng và kích thích, tạo sai lệch cho các khu vực không được khám phá.

Tìm hiểu cách giải pháp Xác minh DFT Questa One, kết hợp với Giải pháp Lifecycle Solutions Tessent Silicon Lifecycle Solutions mang lại sự phát triển về trải nghiệm người dùng và hiệu suất để giải quyết những thách thức xác minh mới nổi này.

Tìm hiểu cách Questa One Sim FX tối ưu hóa các chiến dịch lỗi với khả năng tối ưu hóa danh sách lỗi và xếp hạng thử nghiệm, đồng thời tích hợp liền mạch với môi trường thử nghiệm hiện có và khả năng phân tích lỗi toàn diện.

Khám phá cách Questa Verification IQ Testplan Author tích hợp với các công cụ Quản lý vòng đời ứng dụng (Siemens Polarion và Jama) để cung cấp giải pháp truy xuất nguồn gốc hợp tác giúp thay đổi quy trình xác minh của bạn

Phiên này đã giới thiệu một giải pháp chuyển đổi về các nền tảng được kết nối với các phương pháp tiếp cận dựa trên dữ liệu và Tích hợp AI để giải quyết những thách thức phải đối mặt bởi sự phụ thuộc lẫn nhau, hạn chế và hiệu quả của lực lượng lao động và đảm bảo chất lượng.

Trong hội thảo trên web này, chúng tôi sẽ khám phá cách phân loại lỗi chức năng giúp tăng cường phạm vi bảo hiểm lỗi. Tìm hiểu những lợi thế của việc tích hợp phân loại lỗi chức năng vào các quy trình DFT, cụ thể là giải quyết các lỗi không thể kiểm tra bằng các bài kiểm tra quét.

Phiên này bao gồm Avery Verification IP for Ethernet 1.6T, Infiniband, UALink và UEC; cung cấp vùng phủ sóng giao thức toàn diện, khả năng mở rộng và gỡ lỗi nâng cao để xác minh các thiết kế phức tạp cho kết nối thế hệ tiếp theo.

Hội thảo trên web này sẽ đi sâu vào vai trò quan trọng của xác minh bảo mật phần cứng, phác thảo lý do tại sao nó lại cần thiết để bảo vệ các thiết kế FPGA hiện đại từ RTL đến luồng bit FPGA. Nổi bật: Bitwise của Red Balloon Security

Trong hội thảo trên web này, chúng tôi sẽ khám phá sức mạnh của mã gỡ lỗi và phạm vi chức năng trong khi mô phỏng RTL vẫn đang chạy và cách phân tích phạm vi phủ sóng tương tác có thể dẫn đến việc thiết kế và thử nghiệm nhanh hơn đáng kể.

Phiên này sẽ chỉ ra cách tăng tốc phân tích nguyên nhân gốc rễ và giảm vòng quay gỡ lỗi với Questa Verification IQ Regression Navigator - một giải pháp xác minh dựa trên dữ liệu dựa trên trình duyệt cộng tác thế hệ tiếp theo.

Phiên này sẽ đi sâu vào các tính năng nâng cao của IP xác minh PCIe Gen 7 của Avery, bao gồm tạo thử nghiệm động, tạo lưu lượng truy cập tinh vi, tiêm lỗi và kiểm tra tuân thủ giao thức

Hội thảo trên web này sẽ tập trung vào việc sử dụng SafetyScope trong suốt chu kỳ thiết kế an toàn: giai đoạn kiến trúc, giai đoạn RTL và giai đoạn hậu tổng hợp. Demos: Các số liệu FIT và ISO 26262, nếu phân tích để đạt được ASIL B, tối ưu hóa danh sách lỗi.

Gỡ lỗi thử nghiệm có thể là một thách thức, vì vậy hội thảo trên web này sẽ hiển thị các khả năng đơn giản hóa và đẩy nhanh quá trình như bước dòng cơ bản, giám sát biến động, gỡ lỗi ràng buộc và trực quan hóa cấu trúc liên kết UVM

Hội thảo trên web này sẽ trang bị cho bạn các phương pháp tuân thủ an toàn và bảo mật toàn diện để giải quyết các yêu cầu hiện tại và mới nổi đối với các thiết kế FPGA bằng cách sử dụng Kiểm tra tương đương FPGA từ RTL đến Bitstream.

Phiên này sẽ khám phá các tính năng Hồi quy thông minh mạnh mẽ trong Questa Verification IQ Regression Navigator của Siemens EDA - một giải pháp xác minh dựa trên dữ liệu AI/ML dựa trên trình duyệt cộng tác thế hệ tiếp theo.

Hội thảo trên web này sẽ chỉ ra những hạn chế của việc xác minh mô hình tham chiếu FPU C ++ hiện có so với quy trình thay thế sử dụng kiểm tra thuộc tính chính thức để xác minh hiệu quả các thiết kế FPU; đảm bảo độ chính xác và độ tin cậy của chúng.

Tìm hiểu về vai trò của AI/ML trong việc tăng năng suất xác minh. CI tự động cải thiện chất lượng RTL & phát triển. Xác minh bảo mật chính thức ngăn chặn sự hỏng hóc dữ liệu. Khám phá những tiến bộ mô phỏng RTL mới nhất.

Tìm hiểu cách sự thay đổi mô hình AI/ML mới trong toàn ngành giúp tăng năng suất xác minh chức năng với Questa One.

Tham gia cùng chúng tôi để thảo luận về các tiêu chuẩn giao diện AI/ML và cách IP và quy trình xác minh thế hệ tiếp theo của Avery trao quyền cho các nhóm RTL xác minh các thiết kế giao thức hiệu suất cao cho 3DIC & SoC. Nâng cao chiến lược xác minh của bạn!

Sự kiện độc đáo này mang đến cho người tham dự một nơi để kết nối với các đồng nghiệp, đặt câu hỏi của các chuyên gia và nói chuyện với các nhà cung cấp cung cấp nhiều loại sản phẩm và dịch vụ.

Hội thảo Học viện Xác minh miễn phí này sẽ chỉ ra cách tận dụng IP xác minh thế hệ tiếp theo để nhanh chóng xác minh các thiết kế giao thức hiệu suất cao đang được sử dụng trên 3DIC và SoC ngày nay. Bao gồm bữa trưa miễn phí.

thẩm thấu mang đến một cơ hội duy nhất để kết nối và tương tác với các chuyên gia R & D và những người tham gia đồng nghiệp. Nếu bạn có một câu chuyện hấp dẫn về thành tích, chúng tôi chân thành gửi lời mời bạn tiết lộ nó tại thẩm thấu.

Hội nghị Verification Futures cung cấp sự pha trộn độc đáo giữa các bài thuyết trình hội nghị, triển lãm, đào tạo và các phiên kết nối trong ngành dành riêng để thảo luận về những thách thức phải đối mặt trong xác minh phần cứng và phần mềm.

Từ những trải nghiệm dựa trên AI đắm chìm đến khả năng lãnh đạo tư duy trên sân khấu DAC, Siemens đang xác định lại những gì có thể có trong EDA. Tham gia cùng chúng tôi tại DAC 2025 để khám phá sự đổi mới trong hành động.

Nhấp để tìm hiểu các công nghệ và kỹ thuật mới mà bạn có thể áp dụng ngay hôm nay để tăng năng suất thiết kế và xác minh của mình, đồng thời xem trước lộ trình của chúng tôi.

Nhấp để tìm hiểu các công nghệ và kỹ thuật mới mà bạn có thể áp dụng ngay hôm nay để tăng năng suất thiết kế và xác minh của mình, đồng thời xem trước lộ trình của chúng tôi.

Loạt sự kiện thẩm thấu là một nền tảng năng động để trao đổi những thành công đạt được thông qua việc áp dụng các kỹ thuật chính thức để vượt qua các thách thức xác minh và kết nối với các chuyên gia R & D giỏi và người dùng cuối của chúng tôi.