Quando os designers movem descrições de alto nível para RTL, ou fazem otimizações de energia para RTL, eles devem saber se o resultado é funcionalmente equivalente ao original. Os motores SLEC fornecem soluções para verificação de equivalência RTL manual, de alto nível (gerada por catapulta) e de equivalência RTL otimizada.
Emparelhado com uma gama dos melhores motores da categoria, esta poderosa abordagem de verificação permite a caça de bugs, verificação delimitada e estratégias à prova de completo. O SLEC foi concebido para complementar a verificação típica baseada em simulação e está integrado com ferramentas de depuração como o Siemens EDA Visualizer para compreender falsificações.
Para os desafios de verificação formal manual mais difíceis envolvendo implementações complexas em RTL codificado manualmente. O sistema SLEC-oferece capacidades que permitem a prova formal de blocos de design tão desafiadores como a multiplicação de ponto flutuante de dupla precisão, multiadição e outros problemas que simplesmente não podem ser simulados exaustivamente no RTL.
A biblioteca de training a pedido Catapult High-Level Synthesis (HLS) contém um conjunto de caminhos de aprendizagem com módulos para apresentar aos engenheiros o HLS e verificação de alto nível.
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