DFT 검증의 문제를 해결하도록 설계
설계 크기가 최대 40B 게이트에 대해 풀칩 시스템온칩 (SoC) 에서 넷리스트 또는 레지스터 전송 레벨 (RTL) 을 효율적으로 처리합니다.
기존의 구조 테스트, 메모리 내장 자체 테스트 (MBIST) 또는 고급 테스트 설계 (DFT), 파라메트릭, I/O 특성화 및 기능 테스트와 같은 형식을 실행하든 관계없이 Veloce DFT App은 프로덕션 SoC에서 실행되는 다양한 DFT 테스트 모드를 모두 처리할 수 있습니다.
영업팀 1-800-547-3000에 문의하십시오.

Veloce Design-for-Test (테스트를 위한 설계) 앱은 테스트 패턴 검증을 위한 설계에 대한 쉬프트 레프트 접근 방식을 제공합니다.Veloce DFT App은 에뮬레이션에 최적화된 DFT 패턴 검증 플로우로, 기존 소프트웨어 시뮬레이션보다 빠릅니다.DFT 앱은 ATE (자동 테스트 장비) 에서 실행되는 다양한 유형의 테스트 패턴 모두와 호환됩니다.Veloce DFT App은 Veloce Fault App과 완벽하게 호환되어 결함 커버리지를 정확하게 측정하거나 기능적 결함 등급 메트릭을 제공합니다.이는 Veloce Power App, 전력 프로파일링 및 패턴 추정과 함께 사용되어 매우 견고한 생산 프로그램을 보장합니다.
설계 크기가 최대 40B 게이트에 대해 풀칩 시스템온칩 (SoC) 에서 넷리스트 또는 레지스터 전송 레벨 (RTL) 을 효율적으로 처리합니다.
Veloce DFT는 기존 시뮬레이션보다 훨씬 뛰어난 성능을 제공합니다.경우에 따라 성능의 16K 배에 달합니다.
Veloce DFT App은 업계 전반의 표준 테스트 인터페이스 언어 (STIL) 파일 형식을 지원합니다.
SoC를 완전히 검증하기 위해 실행해야 하는 테스트 패턴의 수에 따라 시간과 비용이 소요됩니다.이러한 대형 패턴 세트는 견고하고 첫 번째 실리콘 사용 시 제대로 작동해야 생산 납품 일정을 방해하지 않습니다.소프트웨어 시뮬레이션보다 10,000배 이상 빠른 Veloce DFT App 및 에뮬레이션 기반 가속화를 통해 목표 달성을 위한 보다 공식적인 검증 프로세스를 수립할 수 있습니다.

Veloce DFT를 사용하면 설계의 구조 분석을 실행하여 생산 프로그램의 커버리지 허점을 찾아냅니다.이러한 결함 집합이 발견되고 자극이 생성되면 Veloce DFT 및 Fault Apps는 반복적인 방식으로 테스트를 실행하고 결함을 주입하는 프로세스를 완전히 자동화합니다.최종 테스트 프로그램 커버리지를 위해 결과 결함 커버리지를 ATPG 커버리지 데이터베이스와 병합할 수 있습니다.

구조적 DFT 테스트 방법은 작동하지 않는 테스트 전용 로직을 설계에 추가합니다. 이 경우 파워 네트와 설계 레이아웃이 이러한 추가 로직에 맞게 최적화되지 않아 테스트에서 전력, 온도 및 속도 이벤트가 발생하여 수율이 감소하고 프로젝트 수익에 영향을 미칠 수 있습니다.Veloce DFT 앱을 Veloce Power 앱과 함께 사용하면 설계 및 계획 초기에 전력 이벤트와 추정에 대한 통찰력을 얻을 수 있습니다.
