概要
回路設計
デザインのキャプチャ、シミュレーションのセットアップ、起動、結果分析の検証を提供するアナログミックスドシグナルのデザインフロー。<br/><br/>
主な機能
Custom IC Design キャプチャ
S-Editは、最も複雑なIC設計を処理しながら生産性を向上させます。回路図が作成されたら、必要なAnalog Mixed シミュレーションの実行を設定して起動し、結果を分析できます。次に、回路図駆動型レイアウトを使用してレイアウトプロセスを進めることができます。
最も複雑なフルカスタムデザインにも対応します
- オープンアクセスのネイティブ
- SPICE、回路図、Verilog、Verilog-A、レイアウト、Verilog-AMS、VHDL、VHDL-AMSビューを含むアナログ・ミックスド・シグナル・デザインをサポートするためのセルごとのマルチビュー
- SDLとECOを通じて、回路図からレイアウトまでのプロセスをスピードアップします
- 30以上のファウンドリからの180以上のPDKによってサポートされています
- Tcl/tkコマンド言語を使用して完全にスクリプト化および拡張可能
フル機能の回路図キャプチャ環境
- 高度なアレイとバスのサポート
- 継承されたコネクションのサポート
- 2つの回路図を比較して、違いを視覚的に表示します
- 回路図、レイアウト、Calibre LVSレポート間のクロスプローブ、ネット/デバイスの強調表示付き
- 構成可能な回路図電気ルールチェック（ERC）
- リビジョン管理ツールとの統合
- LinuxとWindows ズの両方で利用可能です
シミュレーションのセットアップ、起動、結果の表示
- すべてのシミュレーション実行の合格/不合格シミュレーションステータスをすばやく確認できます
- デバイスのDC OPシミュレーション結果とAC小信号パラメータを回路図に直接バックアノテートします
- シミュレーション解析やシミュレータのさまざまなセット用に複数のテストベンチを定義できます
- スイープ、コーナー、モンテカルロ、その他の分析を簡単に設定できます
- プロジェクトのすべてのシミュレーション測定値を追跡して集計します
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