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大きな金属構造の産業環境で、保護具を操作する機械を扱う人
RTLからGDSへのデジタル実装

Aprisaデジタル実装ソリューション

高度なプロセスノードで設計するには、複雑化するチップを管理し、スケジュールを短縮し、開発コストを高くする必要があります。Aprisaの詳細ルート中心のアーキテクチャは、RTLからGDSへのフローのより迅速な設計終了とより予測可能なPPAにより、これらの課題に対応します。

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ジェネレーティブAIとエージェントAIによるRTLからGDSへのデジタル実装:アプリサAIとSiemens EDA A AIシステムを搭載

プレースアンドルート技術でSoC設計を加速

Aprisa デジタル実装は、トップレベルの階層設計とブロックレベルの実装のための完全な合成と配置とルーティング機能を提供するRTL-to-GDSソリューションです。これは、STAのタイミングとDRCの両方で、サインオフツールとテープアウトの品質を相関させることで、設計上の妥協を減らし、最適なパフォーマンス、電力、面積(PPA)を保証します。

Aprisaデジタル実装ソリューション

Aprisa は、物理的に認識されたRTL合成を含む、RTLからGDSへの完全なサポートを提供しています。統一された階層データモデルと共有基盤エンジンを備えた詳細ルート中心のアーキテクチャに加えて、組み込みのAIテクノロジーにより、PPAクロージャーをより迅速かつ予測可能にし、生産性を迅速に向上させることができます。

主な特長

複雑なIC設計のためのRTLからGDへ

Aprisaは、トップレベルの階層設計と複雑なデジタル設計のブロックレベルの実装のための完全な機能を提供します。その詳細ルート中心のアーキテクチャ、統一された階層データモデル、および共有基盤エンジンにより、設計を迅速に完了し、最適な結果品質(QoR)を実現できます。

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Aprisaの詳細なルート中心のアーキテクチャと統一された階層データモデルにより、物理を意識したRTL合成、配置最適化、CTS最適化、および詳細ルーティング間の効率的かつ頻繁な通信が可能になり、結果の品質が向上し、反復が減り、設計の統合が速くなります。

An SVG diagram illustrating a flow from RTL to GDS with various stages and steps.
RTLからGDSへの設計フローを加速させて

Aprisa デジタル実装ソフトウェアのメリット

Aprisaはすぐに使用できる最適なPPAを提供します。これにより、物理設計者はRTLからGDSへのフローの各ステップでの労力を軽減し、市場投入までの時間を短縮できます。

SoC設計を革新してください

Aprisa リソースライブラリ

物理設計者が非常に複雑な設計の実装を検討している場合でも、最短時間でテープアウトすることを検討している場合でも、Aprisaはほとんどの場合、特定のデジタルIC設計プロジェクトにとって最も重要なPPAと設計メトリックを提供するために、すぐに使用できるように動作します。

接続とコード付きのチップ

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