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Descripción general

Diseño de apilamiento de PCB de alta velocidad

Z-planner Enterprise es una herramienta de planificación del apilamiento que incluye una calculadora de apilamiento de PCB centrada en la impedancia eléctrica y la integridad de la señal que le ayuda a gestionar y optimizar el diseño del apilamiento de PCB. Su biblioteca de materiales laminados de PCB reduce los costes de material sin sacrificar el rendimiento.

Persona que lleva unos cascos de realidad virtual con una interfaz holográfica flotando en la parte delantera
Planificador Z Enterprise

Integridad de la señal a través del diseño (7:20)

Únase al fundador de Z-planner, Bill Hargin, mientras explora las tendencias de los PCB que están llevando a una nueva metodología de diseño de PCB centrada en el uso del software de planificación del apilamiento de PCB. Este vídeo explora cómo se utiliza Z-planner Enterprise para gestionar la integridad y la impedancia eléctricas, proporcionando una solución completa de apilamiento de PCB.

Para pilas según el diseño correcto

Z-planner Enterprise: diseño apilable de alta velocidad

Z-planner Enterprise optimiza el proceso de definición de los requisitos de apilamiento y la documentación de esos requisitos al principio del proceso de diseño, garantizando que las simulaciones de integridad de la señal previas al diseño se basen en los datos laminados más precisos disponibles mediante una metodología de diseño de apilamiento coherente.

Calculadora de apilamiento de PCB

Z-planner Enterprise contiene una calculadora de apilamiento que garantiza la integridad de la señal en un
PCB para varios modelos de impedancia controlada para simular rápidamente el rendimiento eléctrico según la configuración de apilamiento actual.

Al utilizar el solucionador de campo Hyperlynx de Siemens, los usuarios pueden seleccionar impedancias diferenciales específicas para determinar valores de circuito específicos basándose en las especificaciones de traza de cobre y en las características de frecuencia de señal calculadas.

Pérdida de inserción

La planificación del apilamiento requiere algo más que calcular la impedancia controlada. Z-planner Enterprise permite calcular detalladamente las pérdidas por inserción dentro de una pila en cualquier rango de frecuencias. Calcule su pérdida total de inserción y determine las fuentes específicas de esta pérdida, entre ellas:

  • pérdida dieléctrica
  • rugosidad del cobre
  • efecto piel
  • tejido de vidrio torcido
  • pérdida de conductor

Factores de disipación dieléctrica

Al modificar la longitud de las trazas, los factores de disipación dieléctrica y los atributos del material de cobre, Z-planner Enterprise le proporciona una valiosa información sobre la integridad eléctrica de su diseño de apilamiento de PCB.


z-solver PCB stackup calculator image

Comience su prueba gratuita de 30 días ahora.

Prueba gratuita de Z-planner Enterprise

Explore Z-planner Enterprise con nuestra prueba gratuita en línea. Sin necesidad de descargar ni instalar, obtendrá experiencia práctica inmediata con el conjunto de herramientas de diseño apilado de Z-planner Enterprise. Planifique la impedancia y las pérdidas previas al diseño y consulte nuestra completa biblioteca de materiales dieléctricos, con especificaciones detalladas de docenas de materiales laminados de los principales fabricantes.

Z-planner Enterprise incorpora el DFM a su diseño de apilado. Controle la integridad de la señal de su PCB de alta velocidad desde el primer día.

Asistente de diseño de apilamiento de PCB

La Z-planner Enterprise viene equipada con un asistente de apilado avanzado que permite a los usuarios diseñar y refinar un apilamiento de varias capas de forma rápida y completa. Explore las funciones del asistente de apilamiento de Z-planner Enterprise en la prueba gratuita en línea.

Z-planner Enterprise PCB stackup design wizard
El software Z-planner reduce el tiempo que tardamos en especificar y validar las acumulaciones de los fabricantes. Podemos evaluar tres acumulaciones diferentes en una hora, en lugar de en un día, y eso reduce significativamente la cantidad de comunicación de ida y vuelta necesaria con nuestros fabricantes y el equipo de NPI.
Dra. Jayaprakash Balachandran, Líder técnico sénior, Ingeniería de integridad de señales