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Verificación de canales en serie

Diseño y verificación de canales en serie de HyperLynx

HyperLynx realiza tanto un análisis de cumplimiento de interconexiones basado en estándares como una simulación IBIS-AMI basada en modelos de proveedores para enlaces en serie de alta velocidad. El análisis posterior a la ruta automatizado a nivel de sistema incluye la extracción completa de la topología mediante modelado EM 3D integrado con un rendimiento escalable.

Visualización técnica del diseño de canales en serie con elementos de circuitos digitales y conexiones de flujo de datos.

El apoyo más amplio de los estándares

A diagram showing various SerDes protocols and their applications in high-speed data transmission.

HyperLynx admite más de 250 protocolos y variantes diferentes del Ethernet, Canal de fibra, HDMI, JED, MIPI D-PHY, IF-CEI, PCI-e y USB familias.

Los enlaces en serie deben cumplir con los requisitos de los documentos de especificación de estándares asociados. Estas especificaciones establecen los requisitos para el dispositivo transmisor (Tx) y el paquete IC, la interconexión a nivel de sistema pin a pin y el paquete IC del dispositivo receptor (Rx). Estos documentos son largos (a menudo cientos de páginas) y detallados. Entender completamente una sola norma es una tarea enorme, pero hay docenas de ellas, con cientos de variantes.

Los expertos de Siemens estudian cada uno de estos estándares para crear configuraciones de simulación que configuren HyperLynx para realizar el flujo de análisis correcto e informar de las métricas asociadas a cada protocolo estándar.

Cada tipo de análisis se especifica mediante un archivo de configuración integrado que configura automáticamente la velocidad del canal, la modulación, la codificación de estímulos, el flujo de análisis y los informes métricos para la simulación de IBIS-AMI y Compliance Analysis. Estos archivos de configuración se pueden copiar y modificar con un editor integrado y se pueden añadir nuevas configuraciones cuando estén disponibles. HyperLynx también incluye un conjunto de configuraciones «genéricas» que son útiles para el análisis rápido de situaciones hipotéticas y la compatibilidad con la creación de prototipos para nuevos protocolos.

Modelado electromagnético 3D integrado

El modelado electromagnético 3D de onda completa de las rupturas de BGA y conectores, mediante transiciones y condensadores de bloqueo, es esencial para un análisis preciso de los enlaces en serie a velocidades superiores a los 5 GT/s. Sin modelos EM 3D precisos para estas áreas, los márgenes a nivel del sistema no se pueden determinar con precisión.

El modelo completo de canales de extremo a extremo se basa en una variedad de elementos diferentes que, por lo general, incluyen archivos de parámetros S (paquetes de circuitos integrados y conectores) suministrados por el proveedor, modelos de rastreo que incluyen efectos de rugosidad de la superficie y archivos de parámetros S de solucionadores EM 3D para representar la ruptura de PCB, a través y el bloqueo de las estructuras de los condensadores. El proceso de dividir el enrutamiento en secciones y, a continuación, crear el modelo de trazado completo a partir de los modelos asociados se conoce como modelado de corte y puntada. Es fundamental que los modelos de las secciones individuales se especifiquen de manera que se puedan unir en cascada sin introducir errores. HyperLynx automatiza este proceso para producir modelos topológicos completos para los enlaces en serie. El modelo de canales se crea en función del conocimiento del protocolo que se está analizando para cumplir con los requisitos del protocolo de resolución y ancho de banda del modelo.

Al extraer un modelo topológico para un enlace en serie, HyperLynx utiliza primero un motor DRC integrado para identificar las áreas que requieren modelado EM 3D. Se identifica un área que contiene la señal y su ruta de retorno y, a continuación, se crea el correspondiente proyecto 3D EM Solver. Este análisis se realiza en todos los canales que se están analizando y las áreas 3D se comparan para que las áreas idénticas no se resuelvan dos veces. Las áreas resultantes se resuelven entonces automáticamente y se crean modelos completos de canal de extremo a extremo para la simulación y el procesamiento de los resultados. HyperLynx automatiza todo este proceso (el diseñador especifica las señales de interés y los criterios para identificar la señal del agresor) y HyperLynx se encarga del resto. Este proceso proporciona una precisión total de modelado de canales comparable a la de modelar todo el canal en un solucionador 3D, a una fracción del coste de cálculo y memoria.

Sleek HyperLynx technology logo with dynamic lines representing scalable digital performance

Para diseños grandes con cientos de canales y miles de áreas, HyperLynx amplía el rendimiento de los solucionadores 3D ejecutando los solucionadores en paralelo a través de una LAN, ya sea aprovechando las funciones de gestión de carga ya instaladas en las instalaciones del cliente o mediante su propio servicio interno de distribución de trabajos.

Análisis de cumplimiento de estándares superiores

Protocol Compliance Analysis examina la interconexión a nivel de sistema pin a pin en un diseño para garantizar que cumple con los requisitos del estándar de protocolo aplicable. Aprovecha los requisitos de interconexión del sistema publicados como parte de la propia norma. Compliance Analysis es especialmente útil porque la mayoría de los diseñadores de sistemas utilizan circuitos integrados estándar; no crean ni los circuitos integrados que utilizan ni los paquetes de circuitos integrados asociados. Compliance Analysis se centra en lo que los diseñadores de sistemas crean realmente: las placas de sistema. Hasta ahora, la única forma que tenían la mayoría de los diseñadores de sistemas de validar su trabajo era ejecutar una simulación de enlaces utilizando modelos de componentes (IBIS-AMI) suministrados por el proveedor. Esto añade una capa de complicación, ya que los modelos IBIS-AMI suelen ser difíciles de obtener y validar, y el proceso de configuración de las simulaciones e interpretar los resultados suele variar de un modelo a otro.

A graphical representation of a compliance test for high-speed serial data transmission systems.

Los estándares de enlace en serie especifican los requisitos detallados para la interconexión de sistemas que se pueden verificar analíticamente. Como los diseñadores de sistemas suelen ser los responsables del diseño de la interconexión de PCB que utiliza componentes estándar, tiene sentido analizar y optimizar el diseño de la interconexión del sistema por sí solo. Eso es exactamente lo que hace HyperLynx Compliance Analysis. Compliance Analysis funciona cuando los modelos de los proveedores (IBIS-AMI) no están disponibles, por lo que siempre se puede ejecutar en un diseño. El flujo de HyperLynx Compliance Analysis es el mismo sin importar los componentes del proveedor que se utilicen, lo que significa que se puede aprender una vez y utilizar en diferentes diseños y proveedores de componentes, en lugar de cambiar cada vez. El flujo de HyperLynx es incluso constante en varios protocolos, a diferencia de otras técnicas basadas en estándares que varían las herramientas utilizadas y la metodología analítica de un protocolo a otro.

HyperLynx Compliance Analysis produce un informe HTML completo que muestra cómo las características del canal se comparan con los requisitos de tiempo y frecuencia. Se muestran los márgenes operativos del canal con una «especificación» de Tx y Rx, junto con los ajustes óptimos del ecualizador determinados automáticamente y utilizados para realizar el análisis. El informe contiene una gran cantidad de datos detallados que son útiles para determinar cómo se podría mejorar el diseño del canal.

Compliance Analysis es más rápido y fácil de ejecutar que la simulación con modelos IBIS-AMI de proveedores. Si Compliance Analysis muestra que un diseño funciona con dispositivos Tx y Rx basados en especificaciones, Y los dispositivos del verdadero proveedor de componentes cumplen o superan el estándar, entonces cabe esperar que todo el sistema funcione. Se sigue recomendando el análisis IBIS-AMI para la firma del diseño, pero Compliance Analysis es la forma ideal de analizar y depurar los diseños antes de invertir el tiempo y el esfuerzo necesarios para una simulación completa del IBIS-AMI.

Simulación IBIS-AMI

La simulación con modelos suministrados por el proveedor (IBIS-AMI) es la forma más precisa de análisis de enlaces en serie, ya que modela los dispositivos reales y las capacidades de ecualización que se utilizarán para la Tx y la Rx en un enlace en serie. Cuando los circuitos integrados reales superen los requisitos de la norma, esos comportamientos se reflejarán en un aumento del margen operativo del enlace. Como los modelos IBIS-AMI reflejan las capacidades y ajustes reales de ecualización de los dispositivos físicos, se puede utilizar la simulación para determinar los ajustes de ecualización que deben implementarse a nivel de sistema.

Sin embargo, este aumento de precisión tiene un precio: el esfuerzo necesario para obtener y validar los modelos IBIS-AMI para su uso, junto con el esfuerzo adicional necesario para configurar las simulaciones e interpretar los resultados de la simulación. Los modelos IBIS-AMI vienen en 3 tipos principales, a menudo denominados modelos estadísticos (solo de inicio), de dominio temporal (solo de GetWave) y duales (tanto de inicio como de Getwave). Esto significa que los flujos de análisis variarán entre las diferentes combinaciones de modelos, ya que los flujos de análisis se basan en los tipos de modelos que se utilizan en la simulación. El uso eficaz de los modelos IBIS-AMI requiere entender los diferentes tipos de modelos y su aplicación adecuada; normalmente es una tarea para especialistas en simulación dedicados. Por este motivo, se recomienda aplazar la simulación IBIS-AMI, que requiere mucha experiencia, y utilizar primero Compliance Analysis para identificar y resolver tantos problemas como sea posible. Una ventaja adicional es que los modelos de canales creados para Compliance Analysis se pueden reutilizar directamente para la simulación IBIS-AMI, por lo que todo el trabajo detallado de modelado de canales ya está hecho.

Person in black shirt standing against white wall with black border, holding a dark object.
Información general

Ecualización de canales SERDES para interfaces en serie

Los nuevos protocolos SerDes estándar del sector, como PCIe Gen6, USB4 y los estándares Ethernet y OIF/CEI de 100 G por línea, ofrecen varios desafíos únicos para los diseñadores de PCB. Si bien las velocidades se duplican aproximadamente en cada generación, el material dieléctrico utilizado sigue siendo el mismo durante generaciones. Para compensar el aumento de la pérdida a velocidades de datos más altas, se emplean técnicas de ecualización complejas.

Libro blanco promocional de SERDES, serie Signal Integrity

Resources