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Avery Verification IP

Avery Verification IP for AMBA

Schnelleres Vertrauen in die simulationsgestützte Überprüfung von RTL-Designs mit ARM AMBA-Busschnittstellen wie AXI, AHB, APB, CHI, ACE

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Ein vergrößerter Ausschnitt des Layouts einer Siliziumchip-Komponente.

Warum Avery Verification IP for AMBA?

Ermöglichen Sie System-on-Chip (SoC) und IP-Entwicklern, eine umfassende Funktionsüberprüfung ihrer IP und SoCs durchzuführen. Avery Verification IP for AMBA umfasst die gesamte Palette der AMBA-Busprotokolle (AXI4 — Full, Lite, Stream, AXI3, AHB, APB, CHI) Master-, Slave- und Interconnect-Funktionen und gewährleistet die Einhaltung der AMBA-Standards.

Lieferbestandteile

  • Master, Slave, BFMs miteinander verbinden
  • Beispiel für eine Testsuite
  • Bedienungsanleitung

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Verification Academy

Die Verification Academy vermittelt die Fähigkeiten, die erforderlich sind, um die Fähigkeiten eines Unternehmens im Bereich der funktionalen Verifizierung weiterzuentwickeln, und bietet eine methodische Brücke zwischen den Leistungsversprechen auf hoher Ebene und den Details auf niedriger Ebene.

Der Blog von Verification Horizons

Einblicke und Updates zu Konzepten, Werten, Standards, Methoden und Beispielen, um zu verstehen, was fortschrittliche Technologien zur Funktionsüberprüfung leisten können und wie sie am effektivsten angewendet werden können.

Verification Horizons

Die Veröffentlichung von Verification Horizons enthält Konzepte, Werte, Methoden und Beispiele, um zu verstehen, was fortschrittliche Technologien zur funktionalen Verifikation leisten können und wie sie am effektivsten angewendet werden können.