Visão geral
Projeto de Circuito
Um fluxo de design analógico de sinal misto que fornece captura de design, configuração de simulação, lançamento e verificação de análise de resultados.<br/><br/>
Principais características
Captura de Custom IC Design
O S-Edit aumenta a produtividade ao manusear os designs de IC mais complexos. Uma vez criado o esquema, as execuções de simulação analógica mista necessárias podem ser configuradas, lançadas e os resultados analisados. Em seguida, o layout orientado por esquemas pode ser usado para conduzir o processo de layout.
Lido com os seus designs totalmente personalizados mais complexos
- Nativo no OpenAccess
- Múltiplas visualizações por célula para suportar o design analógico de sinal misto, incluindo: visualizações SPICE, esquemático, Verilog, Verilog-A, layout, Verilog-AMS, VHDL e VHDL-AMS
- Velocidades esquemáticas para o processo de layout através de SDL e ECO
- Apoiado por mais de 180 PDK's de mais de 30 fundições
- Totalmente scriptável e expansível usando a linguagem de comando TCL/TK
Ambiente de captura esquemática completo
- Suporte avançado para matrizes e autocarros
- Suporte para ligações herdadas
- Compare dois esquemas e exibe visualmente as diferenças
- Sonda cruzada entre esquema, layout e relatório Calibre LVS com realce de rede/dispositivo
- Verificações esquemáticas de regras elétricas configuráveis (ERC)
- Integração com ferramentas de controlo de revisão
- Disponível tanto no Linux como no Windows
Configuração da simulação, lançamento e visualização de resultados
- Veja rapidamente o status da simulação de passar/falha de todas as execuções de simulação
- Anotar novamente os resultados da simulação DC OP e os parâmetros de sinal pequeno CA para dispositivos diretamente no esquema
- Podem ser definidas várias bancadas de teste para diferentes conjuntos de simulação, análise ou simuladores
- Configure facilmente varredura, cantos, Monte Carlo e outras análises
- Acompanhar e agregar todas as medições de simulação para um projeto
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