Denne HL-SYC-utvidelsen

I dette webinaret vil du lære hvorfor formell verifisering er nøkkelkomponenten for å lykkes i æraen med Next Normal, hvor suksess med silisium først er avgjørende og det er viktig å sikre kvalitet på tvers av verifiseringssyklusen din.

I dette webinaret diskuterer vi følgende teknikker: Grunnleggende abstraksjon, sette opp og optimalisere begrensninger, datauavhengighet og ikke-determinisme. Disse metodene er enkle å bruke, og øker formell analyseytelse.

I dette webinaret vil vi vise hvordan du med litt designkunnskap og omtanke fra din side kan utnytte disse to prinsippene (DI og ND) for å kutte ned den formelle analysen til noen minutter kontra timer.

I dette webinaret vil vi vise deg hvordan du bruker IEEE standard Property Checking Code (SVA) og ferdige formelle verktøy for raskt og uttømmende å verifisere datatransport gjennom DUT samsvarer med spesifikasjonen.

I dette webinaret lærer du hvilke typer DUT-konstruksjoner som ofte forårsaker formelle analyseproblemer, og hvordan du bruker tidstestede teknikker for å trygt abstrahere dem bort slik at formell verifisering raskt kan nå avslutning.

I dette webinaret vil vi vise deg hvordan du skriver optimale begrensninger for formell analyse; og hvordan du bevisst under- og overbegrenser analysen for å lære mer om effektiviteten til begrensningene.

I dette webinaret lærer du hvordan FPGA-implementeringsverifisering kan akselerere designflyten, redusere testing i laboratoriet, muliggjøre aggressiv optimaliseringsbruk og dramatisk redusere risikoen etter produksjonen.

Beskyttelse av maskinvaren din er like viktig som å beskytte programvaren mot cyberangrep. Denne økten vil demonstrere tidlig sikkerhetsverifisering på en liten modul av immateriell eiendom (IP) beregnet for IC-integrasjon.

I dette webinaret vil du få en forståelse av de automatiske formelle applikasjonene som kan brukes til å løse nåværende design- og verifiseringsutfordringer som ofte sees når du utvikler ASIC- og FPGA-design.

I dette webinaret vil vi vise hvordan du bruker en automatisert, formelt basert flyt som sikrer fullstendig dekning av registerets tilstandsområde, uttømmende verifiserer atferd og ulovlig oppførsel uten å måtte lære formelt i det hele tatt.

I dette webinaret vil vi dekke formell metodikk i detalj med fokus på ABC-ene for formelle: (A) abstraksjon, (B) insektjakt og byggevis, og (C) dekning i sammenheng med eiendomskontroll.

I dette webinaret ser du den brukervennlige formelle appens progresjon til de første trinnene i formell eiendomskontroll; den praktiske ideen om uttømmende formell verifisering på modulnivå til løftet om eiendomsdrevet utvikling.

I dette webinaret vil vi dele en omfattende statisk og formelt basert metodikk som bruker Questa X-Check-autmatert applikasjon som gjør det mulig for designteam å rote årsaken til 'X' -problemer tidlig i RTL-designprosessen.

I dette webinaret lærer du hvordan du utnytter formell analyse for å finne og fikse så mange funksjonelle feil som mulig, til slutt forbedre kvaliteten på sluttproduktet ditt og redusere risikoen for re-spinn.

I dette webinaret lærer du hvorfor bruk av formell tidlig i utviklingen forkorter den totale verifiseringssyklusen ved å finne og fikse de fleste feilene under utviklingen i stedet for sent i bekreftelsesspillet.