Avery VIP pour contrôler les VIP en série

Pourquoi Avery Verification IP for Control/Serial Buses ?

Un portefeuille complet de solutions de mémoire VIP pour I3C et I2C est utilisé par les concepteurs de systèmes sur puce (SoC) et IP pour assurer la vérification complète et la conformité aux protocoles et au calendrier. Avery Verification IP for Control/Serial Buses implémente un ensemble complet de modèles, de vérificateurs de protocole et de suite de tests de conformité dans SystemVerilog et UVM 100% natifs.

Livrables

BFM maître et esclave I3C/i2C/SMBUS
Suite de tests de conformité
Guide de l'utilisateur

Famille de protocoles	Organisation standard	Modèles
EMBUS	Forum sur l'interface de gestion du système	SMBUS - Ver 3.1
I2C	NXP	UM10204
I3C	MIPI	I3C 1.1
	MIPI	I3C HCI 1.1
	MIPI	I3C Basic 1.1
	MIPI	Débogage I3C 1.0
	MIPI	SPP 2.0
	MIPI	ÉTAPE 2.2

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