Plataforma de creación de prototipos de software
Veloce proFPGA CS
Veloce ProFPGA CS es la plataforma de creación de prototipos de software de más alto rendimiento optimizada para la verificación de software y la validación de la integración de sistemas de hardware/software. Esta es una plataforma altamente flexible y asequible, desde FPGA simple hasta multi-blade para diseños muy grandes.
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Prototipos de alto rendimiento para verificación de software
El software en los productos actuales está creciendo en complejidad, verificar el software temprano es clave para el éxito del producto y el tiempo de comercialización. El rendimiento rápido de ProFPGA CS, las interfaces rápidas y la escalabilidad permiten a los equipos de software validar y depurar el software mucho antes de la disponibilidad de silicio.
El rendimiento es lo primero
El hardware de Veloce ProFPGA CS ha sido diseñado con el mayor rendimiento posible como objetivo principal. El rendimiento es esencial para permitir la verificación de cargas de trabajo de software complejas, arrancar el sistema operativo, ejecutar aplicaciones en una plataforma de creación de prototipos totalmente configurable adaptada a las necesidades específicas del proyecto. El sistema de escritorio Veloce ProFPGA CS puede ofrecer un rendimiento en el rango de 100 Mhz.
Escalabilidad y flexibilidad
Veloce ProFPGA CS es altamente escalable, desde una sola cuchilla en el escritorio hasta configuraciones de montaje en rack multiblade para entornos multiusuario. Los usuarios tienen la flexibilidad de definir el número de FPGA, las interconexiones, las interfaces de protocolo a velocidad, que mejor se adapten a las necesidades de verificación y rendimiento del proyecto.
Trae a colar rápido
Veloce ProFPGA CS cuenta con software automático para acelerar la puesta en marcha del diseño en la plataforma prototipo. El software Veloce elimina las tareas manuales de modificar el diseño para que sea compatible con FPGA, sin riesgos de sincronización cuando se ejecuta en el FPGA. El software puede realizar una partición totalmente automatizada, así como guiada por el usuario del diseño entre dispositivos multi-FPGA.
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