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Warum Avery Verification IP for Control/Serial Buses Buses?

Ein umfassendes Portfolio an Speicher-VIP-Lösungen für I3C und I2C wird von System-on-Chip- (SoC) und IP-Designern verwendet, um eine umfassende Überprüfung sowie die Einhaltung von Protokoll- und Timing-Anforderungen sicherzustellen. Avery Verification IP for Control/Serial Buses implementiert einen kompletten Satz von Modellen, Protokollprüfern und Compliance-Testsuiten in 100% nativem SystemVerilog und UVM.

Lieferbestandteile

  • I3C/I2C/SMBus-Master- und -Slave-BFMs
  • Testsuite für Compliance
  • Benutzerleitfaden

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Verification Academy

Die Verification Academy vermittelt die Fähigkeiten, die erforderlich sind, um die Fähigkeiten eines Unternehmens im Bereich der funktionalen Verifizierung weiterzuentwickeln, und bietet eine methodische Brücke zwischen den Leistungsversprechen auf hoher Ebene und den Details auf niedriger Ebene.

Der Blog von Verification Horizons

Einblicke und Updates zu Konzepten, Werten, Standards, Methoden und Beispielen, um zu verstehen, was fortschrittliche Technologien zur Funktionsüberprüfung leisten können und wie sie am effektivsten angewendet werden können.

Verification Horizons

Die Veröffentlichung von Verification Horizons enthält Konzepte, Werte, Methoden und Beispiele, um zu verstehen, was fortschrittliche Technologien zur funktionalen Verifikation leisten können und wie sie am effektivsten angewendet werden können.